FPGA Introduction Course Training #04 – Testbench Introduction


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– Testbench는 circuit 설계에 중요함. Testbench를 사용해 설계가 옳은지 확인할 수 있음.
– FPGA로 구현하기 이전에 simulation하는 것.
– Testbench를 사용하면 HDL 코드가 옳은지 디버깅할 수 있다.
– Testbench를 사용하면 외부의 파일들을 simulation에 사용할 수 있다.
– Testbench에서는 verilog에서 synthesize 불가능한 부분도 사용할 수 있다.

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– Testbench에서는 테스팅하고자 하는 모듈을 instantiate해야 한다.
– $monitor, $display, $stop, $finish, $error 등이 simulation에서 사용 가능하다.
– #뒤에 delay할 시간을 줄 수 있다.
– Simulation에서는 for loop, 파일 읽기 등도 사용 가능하다.

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– 이 강좌에서는 testbench를 사용해, 이전에 만들었던 ALU를 테스팅한다.
– 일반적인 프로그래밍 언어에서 지원하는 step over, step in을 simulation에서 사용할 수 있다.

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